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1.突發長度(Burst Length,BL)   由於DDR3的預取為8bit,所以突發傳輸周期(Burst Length,BL)也固定為8,而對於DDR2和早期的DDR架構系統,BL=4也是常用的,DDR3為此增加了一個4bit Burst Chop(突發突變)模式,即由一個BL=4的讀取操作加上一個BL=4的寫入操作來合成一個BL=8的數據突發傳輸,屆時可通過A12地址線來控制這一突發模式。而且需要指出的是,任何突發中斷操作都將在DDR3內存中予以禁止,且不予支持,取而代之的是更靈活的突發傳輸控制(如4bit順序突發)。   

2.尋址時序(Timing)   就像DDR2從DDR轉變而來後延遲周期數增加一樣,DDR3的CL周期也將比DDR2有所提高。附加延遲(AL)的設計也有所變化。DDR3時AL有三種選項,分別是0、CL-1和CL-2。另外,DDR3還新增加了一個時序參數——寫入延遲(CWD),這一參數將根據具體的工作頻率而定。   

3.DDR3新增的重置(Reset)功能   重置是DDR3新增的一項重要功能,並為此專門準備了一個引腳。DRAM業界很早以前就要求增加這一功能,如今終於在DDR3上實現了。這一引腳將使DDR3的初始化處理變得簡單。當Reset命令有效時,DDR3記憶體將停止所有操作,並切換至最少量活動狀態,以節約電力。

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